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cd9e219d1b
commit
4ac826a398
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@ -25,6 +25,7 @@ C_SRCS += $(BSP_DIR)/lib/sim_ctrl.c
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C_SRCS += $(BSP_DIR)/lib/timer.c
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C_SRCS += $(BSP_DIR)/lib/timer.c
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C_SRCS += $(BSP_DIR)/lib/gpio.c
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C_SRCS += $(BSP_DIR)/lib/gpio.c
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||||||
C_SRCS += $(BSP_DIR)/lib/rvic.c
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C_SRCS += $(BSP_DIR)/lib/rvic.c
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C_SRCS += $(BSP_DIR)/lib/i2c.c
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LINKER_SCRIPT := $(BSP_DIR)/link.lds
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LINKER_SCRIPT := $(BSP_DIR)/link.lds
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@ -0,0 +1,81 @@
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// Generated register defines for i2c
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// Copyright information found in source file:
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// Copyright lowRISC contributors.
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// Licensing information found in source file:
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// Licensed under the Apache License, Version 2.0, see LICENSE for details.
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// SPDX-License-Identifier: Apache-2.0
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#ifndef _I2C_REG_DEFS_
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#define _I2C_REG_DEFS_
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#ifdef __cplusplus
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extern "C" {
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#endif
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// Register width
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#define I2C_PARAM_REG_WIDTH 32
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#define I2C0_BASE_ADDR (0x60000000)
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#define I2C0_REG(offset) (*((volatile uint32_t *)(I2C0_BASE_ADDR + offset)))
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typedef enum {
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I2C_MODE_MASTER = 0,
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I2C_MODE_SLAVE
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} i2c_mode_e;
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void i2c0_set_clk(uint16_t clk_div);
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void i2c0_set_mode(i2c_mode_e mode);
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void i2c0_master_set_write(uint8_t yes);
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void i2c0_set_interrupt_enable(uint8_t en);
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void i2c0_clear_irq_pending();
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uint8_t i2c0_get_irq_pending();
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void i2c0_master_set_info(uint8_t addr, uint8_t reg, uint8_t data);
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uint8_t i2c0_master_get_data();
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void i2c0_start();
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void i2c0_stop();
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// I2C control register
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#define I2C_CTRL_REG_OFFSET 0x0
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#define I2C_CTRL_REG_RESVAL 0x0
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#define I2C_CTRL_START_BIT 0
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#define I2C_CTRL_INT_EN_BIT 1
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#define I2C_CTRL_INT_PENDING_BIT 2
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#define I2C_CTRL_MODE_BIT 3
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#define I2C_CTRL_WRITE_BIT 4
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#define I2C_CTRL_ACK_BIT 5
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#define I2C_CTRL_ERROR_BIT 6
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#define I2C_CTRL_CLK_DIV_MASK 0xffff
|
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#define I2C_CTRL_CLK_DIV_OFFSET 16
|
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#define I2C_CTRL_CLK_DIV_FIELD \
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((bitfield_field32_t) { .mask = I2C_CTRL_CLK_DIV_MASK, .index = I2C_CTRL_CLK_DIV_OFFSET })
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// I2C master transfer data register
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#define I2C_MASTER_DATA_REG_OFFSET 0x4
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#define I2C_MASTER_DATA_REG_RESVAL 0x0
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#define I2C_MASTER_DATA_ADDRESS_MASK 0xff
|
||||||
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#define I2C_MASTER_DATA_ADDRESS_OFFSET 0
|
||||||
|
#define I2C_MASTER_DATA_ADDRESS_FIELD \
|
||||||
|
((bitfield_field32_t) { .mask = I2C_MASTER_DATA_ADDRESS_MASK, .index = I2C_MASTER_DATA_ADDRESS_OFFSET })
|
||||||
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#define I2C_MASTER_DATA_REGREG_MASK 0xff
|
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#define I2C_MASTER_DATA_REGREG_OFFSET 8
|
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#define I2C_MASTER_DATA_REGREG_FIELD \
|
||||||
|
((bitfield_field32_t) { .mask = I2C_MASTER_DATA_REGREG_MASK, .index = I2C_MASTER_DATA_REGREG_OFFSET })
|
||||||
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#define I2C_MASTER_DATA_DATA_MASK 0xff
|
||||||
|
#define I2C_MASTER_DATA_DATA_OFFSET 16
|
||||||
|
#define I2C_MASTER_DATA_DATA_FIELD \
|
||||||
|
((bitfield_field32_t) { .mask = I2C_MASTER_DATA_DATA_MASK, .index = I2C_MASTER_DATA_DATA_OFFSET })
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||||||
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// I2C slave received data register
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#define I2C_SLAVE_DATA_REG_OFFSET 0x8
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#define I2C_SLAVE_DATA_REG_RESVAL 0x0
|
||||||
|
#define I2C_SLAVE_DATA_SLAVE_DATA_MASK 0xff
|
||||||
|
#define I2C_SLAVE_DATA_SLAVE_DATA_OFFSET 0
|
||||||
|
#define I2C_SLAVE_DATA_SLAVE_DATA_FIELD \
|
||||||
|
((bitfield_field32_t) { .mask = I2C_SLAVE_DATA_SLAVE_DATA_MASK, .index = I2C_SLAVE_DATA_SLAVE_DATA_OFFSET })
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|
#ifdef __cplusplus
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|
} // extern "C"
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|
#endif
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#endif // _I2C_REG_DEFS_
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// End generated register defines for i2c
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@ -0,0 +1,73 @@
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#include <stdint.h>
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#include "../include/i2c.h"
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void i2c0_set_clk(uint16_t clk_div)
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{
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|
I2C0_REG(I2C_CTRL_REG_OFFSET) &= ~(I2C_CTRL_CLK_DIV_MASK << I2C_CTRL_CLK_DIV_OFFSET);
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||||||
|
I2C0_REG(I2C_CTRL_REG_OFFSET) |= clk_div << I2C_CTRL_CLK_DIV_OFFSET;
|
||||||
|
}
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|
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||||||
|
void i2c0_set_mode(i2c_mode_e mode)
|
||||||
|
{
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|
if (mode == I2C_MODE_MASTER)
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||||||
|
I2C0_REG(I2C_CTRL_REG_OFFSET) &= ~(1 << I2C_CTRL_MODE_BIT);
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||||||
|
else
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||||||
|
I2C0_REG(I2C_CTRL_REG_OFFSET) |= 1 << I2C_CTRL_MODE_BIT;
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||||||
|
}
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|
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|
void i2c0_master_set_write(uint8_t yes)
|
||||||
|
{
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|
if (yes)
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|
I2C0_REG(I2C_CTRL_REG_OFFSET) &= ~(1 << I2C_CTRL_WRITE_BIT);
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||||||
|
else
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||||||
|
I2C0_REG(I2C_CTRL_REG_OFFSET) |= 1 << I2C_CTRL_WRITE_BIT;
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||||||
|
}
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||||||
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void i2c0_set_interrupt_enable(uint8_t en)
|
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|
{
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|
if (en)
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|
I2C0_REG(I2C_CTRL_REG_OFFSET) |= 1 << I2C_CTRL_INT_EN_BIT;
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||||||
|
else
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||||||
|
I2C0_REG(I2C_CTRL_REG_OFFSET) &= ~(1 << I2C_CTRL_INT_EN_BIT);
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||||||
|
}
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||||||
|
|
||||||
|
void i2c0_clear_irq_pending()
|
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|
{
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|
I2C0_REG(I2C_CTRL_REG_OFFSET) |= 1 << I2C_CTRL_INT_PENDING_BIT;
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|
}
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uint8_t i2c0_get_irq_pending()
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|
{
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if (I2C0_REG(I2C_CTRL_REG_OFFSET) & (1 << I2C_CTRL_INT_PENDING_BIT))
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||||||
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return 1;
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||||||
|
else
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||||||
|
return 0;
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|
}
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|
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|
void i2c0_master_set_info(uint8_t addr, uint8_t reg, uint8_t data)
|
||||||
|
{
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|
I2C0_REG(I2C_MASTER_DATA_REG_OFFSET) = (addr << I2C_MASTER_DATA_ADDRESS_OFFSET) |
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||||||
|
(reg << I2C_MASTER_DATA_REGREG_OFFSET) |
|
||||||
|
(data << I2C_MASTER_DATA_DATA_OFFSET);
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|
}
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||||||
|
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||||||
|
uint8_t i2c0_master_get_data()
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|
{
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|
uint8_t data;
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||||||
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data = (I2C0_REG(I2C_MASTER_DATA_REG_OFFSET) >> I2C_MASTER_DATA_DATA_OFFSET) & I2C_MASTER_DATA_DATA_MASK;
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||||||
|
|
||||||
|
return data;
|
||||||
|
}
|
||||||
|
|
||||||
|
void i2c0_start()
|
||||||
|
{
|
||||||
|
I2C0_REG(I2C_CTRL_REG_OFFSET) |= 1 << I2C_CTRL_START_BIT;
|
||||||
|
}
|
||||||
|
|
||||||
|
void i2c0_stop()
|
||||||
|
{
|
||||||
|
I2C0_REG(I2C_CTRL_REG_OFFSET) &= ~(1 << I2C_CTRL_START_BIT);
|
||||||
|
}
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