a10gx- move cores inside qsys
Rejeesh Kutty
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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<interface
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
||||
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|
||||
<interface
|
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|
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|
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|
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|
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|
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|
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<interface name="somf" internal="jesd204_0.somf" />
|
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|
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<interface
|
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|
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|
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|
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|
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|
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|
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|
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<interface
|
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|
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|
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|
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|
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<port name="tx_cal_busy" internal="tx_cal_busy" />
|
||||
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|
||||
<interface
|
||||
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|
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internal="jesd204_0.tx_csr_bit_reversal"
|
||||
type="conduit"
|
||||
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|
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<port name="tx_csr_bit_reversal" internal="tx_csr_bit_reversal" />
|
||||
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|
||||
<interface
|
||||
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|
||||
internal="jesd204_0.tx_csr_byte_reversal"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="tx_csr_byte_reversal" internal="tx_csr_byte_reversal" />
|
||||
</interface>
|
||||
<interface
|
||||
name="tx_csr_lane_polarity"
|
||||
internal="jesd204_0.tx_csr_lane_polarity"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
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|
||||
</interface>
|
||||
<interface
|
||||
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|
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|
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type="conduit"
|
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|
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|
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|
||||
<interface
|
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|
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|
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|
||||
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|
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|
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|
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<interface name="tx_serial_clk0" internal="jesd204_0.tx_serial_clk0" />
|
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<interface
|
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|
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|
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type="hssi_serial_clock"
|
||||
dir="end">
|
||||
<port name="tx_serial_clk0_ch0" internal="tx_serial_clk0_ch0" />
|
||||
</interface>
|
||||
<interface
|
||||
name="tx_serial_clk0_ch1"
|
||||
internal="jesd204_0.tx_serial_clk0_ch1"
|
||||
type="hssi_serial_clock"
|
||||
dir="end">
|
||||
<port name="tx_serial_clk0_ch1" internal="tx_serial_clk0_ch1" />
|
||||
</interface>
|
||||
<interface
|
||||
name="tx_serial_clk0_ch2"
|
||||
internal="jesd204_0.tx_serial_clk0_ch2"
|
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type="hssi_serial_clock"
|
||||
dir="end">
|
||||
<port name="tx_serial_clk0_ch2" internal="tx_serial_clk0_ch2" />
|
||||
</interface>
|
||||
<interface
|
||||
name="tx_serial_clk0_ch3"
|
||||
internal="jesd204_0.tx_serial_clk0_ch3"
|
||||
type="hssi_serial_clock"
|
||||
dir="end">
|
||||
<port name="tx_serial_clk0_ch3" internal="tx_serial_clk0_ch3" />
|
||||
</interface>
|
||||
<interface
|
||||
name="tx_serial_data"
|
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internal="jesd204_0.tx_serial_data"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="tx_serial_data" internal="tx_serial_data" />
|
||||
</interface>
|
||||
<interface
|
||||
name="txlink_clk"
|
||||
internal="jesd204_0.txlink_clk"
|
||||
type="clock"
|
||||
dir="end">
|
||||
<port name="txlink_clk" internal="txlink_clk" />
|
||||
</interface>
|
||||
<interface
|
||||
name="txlink_rst_n"
|
||||
internal="jesd204_0.txlink_rst_n"
|
||||
type="reset"
|
||||
dir="end">
|
||||
<port name="txlink_rst_n_reset_n" internal="txlink_rst_n_reset_n" />
|
||||
</interface>
|
||||
<interface
|
||||
name="txphy_clk"
|
||||
internal="jesd204_0.txphy_clk"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="txphy_clk" internal="txphy_clk" />
|
||||
</interface>
|
||||
<module
|
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name="jesd204_0"
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kind="altera_jesd204"
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version="15.0"
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enabled="1"
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autoexport="1">
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<parameter name="AUTO_DEVICE_SPEEDGRADE" value="2" />
|
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<parameter name="CF" value="0" />
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<parameter name="DATA_PATH" value="RX_TX" />
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<parameter name="DEVICE_FAMILY" value="Arria 10" />
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<parameter name="DID" value="0" />
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|
||||
<parameter name="GUI_EN_CFG_F" value="false" />
|
||||
<parameter name="HD" value="0" />
|
||||
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|
||||
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|
||||
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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</module>
|
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<interconnectRequirement for="$system" name="qsys_mm.clockCrossingAdapter" value="HANDSHAKE" />
|
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<interconnectRequirement for="$system" name="qsys_mm.enableEccProtection" value="FALSE" />
|
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|
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|
||||
</system>
|
||||
|
|
@ -1,174 +0,0 @@
|
|||
<?xml version="1.0" encoding="UTF-8"?>
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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<interface
|
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|
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|
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|
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|
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|
||||
</interface>
|
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<interface
|
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|
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|
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|
||||
dir="end">
|
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|
||||
</interface>
|
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<interface
|
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|
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|
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type="conduit"
|
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|
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|
||||
</interface>
|
||||
<interface
|
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name="pll_select"
|
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|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="pll_select" internal="pll_select" />
|
||||
</interface>
|
||||
<interface
|
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name="reset"
|
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|
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type="reset"
|
||||
dir="end">
|
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|
||||
</interface>
|
||||
<interface
|
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|
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|
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type="conduit"
|
||||
dir="end">
|
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|
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</interface>
|
||||
<interface
|
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|
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|
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|
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dir="end">
|
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|
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</interface>
|
||||
<interface
|
||||
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|
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|
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type="conduit"
|
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|
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|
||||
</interface>
|
||||
<interface
|
||||
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|
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|
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|
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|
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|
||||
</interface>
|
||||
<interface
|
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|
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|
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|
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|
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|
||||
</interface>
|
||||
<interface
|
||||
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|
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|
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|
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|
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|
||||
</interface>
|
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<interface
|
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|
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|
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|
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dir="end">
|
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|
||||
</interface>
|
||||
<interface
|
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|
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internal="xcvr_reset_control_0.tx_digitalreset"
|
||||
type="conduit"
|
||||
dir="end">
|
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|
||||
</interface>
|
||||
<interface
|
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name="tx_ready"
|
||||
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|
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type="conduit"
|
||||
dir="end">
|
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<port name="tx_ready" internal="tx_ready" />
|
||||
</interface>
|
||||
<module
|
||||
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
||||
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|
||||
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|
||||
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|
||||
<parameter name="TX_PER_CHANNEL" value="0" />
|
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|
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|
||||
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|
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|
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|
||||
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|
||||
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|
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|
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|
||||
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|
||||
<parameter name="gui_tx_auto_reset" value="0" />
|
||||
</module>
|
||||
<interconnectRequirement for="$system" name="qsys_mm.clockCrossingAdapter" value="HANDSHAKE" />
|
||||
<interconnectRequirement for="$system" name="qsys_mm.enableEccProtection" value="FALSE" />
|
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|
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|
||||
</system>
|
||||
|
|
@ -1,380 +0,0 @@
|
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<?xml version="1.0" encoding="UTF-8"?>
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<component
|
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|
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|
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|
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|
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|
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|
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]]></parameter>
|
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<parameter name="clockCrossingAdapter" value="HANDSHAKE" />
|
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|
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|
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<parameter name="generateLegacySim" value="false" />
|
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|
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<parameter name="globalResetBus" value="false" />
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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<instanceScript></instanceScript>
|
||||
<interface
|
||||
name="alldev_lane_aligned"
|
||||
internal="jesd204_0.alldev_lane_aligned"
|
||||
type="conduit"
|
||||
dir="end">
|
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<port name="alldev_lane_aligned" internal="alldev_lane_aligned" />
|
||||
</interface>
|
||||
<interface
|
||||
name="csr_bit_reversal"
|
||||
internal="jesd204_0.csr_bit_reversal"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="csr_bit_reversal" internal="csr_bit_reversal" />
|
||||
</interface>
|
||||
<interface
|
||||
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|
||||
internal="jesd204_0.csr_byte_reversal"
|
||||
type="conduit"
|
||||
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|
||||
<port name="csr_byte_reversal" internal="csr_byte_reversal" />
|
||||
</interface>
|
||||
<interface name="csr_cf" internal="jesd204_0.csr_cf" type="conduit" dir="end">
|
||||
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|
||||
</interface>
|
||||
<interface name="csr_cs" internal="jesd204_0.csr_cs" type="conduit" dir="end">
|
||||
<port name="csr_cs" internal="csr_cs" />
|
||||
</interface>
|
||||
<interface name="csr_f" internal="jesd204_0.csr_f" type="conduit" dir="end">
|
||||
<port name="csr_f" internal="csr_f" />
|
||||
</interface>
|
||||
<interface name="csr_hd" internal="jesd204_0.csr_hd" type="conduit" dir="end">
|
||||
<port name="csr_hd" internal="csr_hd" />
|
||||
</interface>
|
||||
<interface name="csr_k" internal="jesd204_0.csr_k" type="conduit" dir="end">
|
||||
<port name="csr_k" internal="csr_k" />
|
||||
</interface>
|
||||
<interface name="csr_l" internal="jesd204_0.csr_l" type="conduit" dir="end">
|
||||
<port name="csr_l" internal="csr_l" />
|
||||
</interface>
|
||||
<interface
|
||||
name="csr_lane_polarity"
|
||||
internal="jesd204_0.csr_lane_polarity"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="csr_lane_polarity" internal="csr_lane_polarity" />
|
||||
</interface>
|
||||
<interface
|
||||
name="csr_lane_powerdown"
|
||||
internal="jesd204_0.csr_lane_powerdown"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
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|
||||
</interface>
|
||||
<interface name="csr_m" internal="jesd204_0.csr_m" type="conduit" dir="end">
|
||||
<port name="csr_m" internal="csr_m" />
|
||||
</interface>
|
||||
<interface name="csr_n" internal="jesd204_0.csr_n" type="conduit" dir="end">
|
||||
<port name="csr_n" internal="csr_n" />
|
||||
</interface>
|
||||
<interface name="csr_np" internal="jesd204_0.csr_np" type="conduit" dir="end">
|
||||
<port name="csr_np" internal="csr_np" />
|
||||
</interface>
|
||||
<interface
|
||||
name="csr_rx_testmode"
|
||||
internal="jesd204_0.csr_rx_testmode"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="csr_rx_testmode" internal="csr_rx_testmode" />
|
||||
</interface>
|
||||
<interface name="csr_s" internal="jesd204_0.csr_s" type="conduit" dir="end">
|
||||
<port name="csr_s" internal="csr_s" />
|
||||
</interface>
|
||||
<interface
|
||||
name="dev_lane_aligned"
|
||||
internal="jesd204_0.dev_lane_aligned"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="dev_lane_aligned" internal="dev_lane_aligned" />
|
||||
</interface>
|
||||
<interface
|
||||
name="dev_sync_n"
|
||||
internal="jesd204_0.dev_sync_n"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="dev_sync_n" internal="dev_sync_n" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_rx_avs"
|
||||
internal="jesd204_0.jesd204_rx_avs"
|
||||
type="avalon"
|
||||
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|
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<port name="jesd204_rx_avs_chipselect" internal="jesd204_rx_avs_chipselect" />
|
||||
<port name="jesd204_rx_avs_address" internal="jesd204_rx_avs_address" />
|
||||
<port name="jesd204_rx_avs_read" internal="jesd204_rx_avs_read" />
|
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|
||||
<port
|
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|
||||
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|
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|
||||
<port name="jesd204_rx_avs_writedata" internal="jesd204_rx_avs_writedata" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_rx_avs_clk"
|
||||
internal="jesd204_0.jesd204_rx_avs_clk"
|
||||
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|
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dir="end">
|
||||
<port name="jesd204_rx_avs_clk" internal="jesd204_rx_avs_clk" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_rx_avs_rst_n"
|
||||
internal="jesd204_0.jesd204_rx_avs_rst_n"
|
||||
type="reset"
|
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dir="end">
|
||||
<port name="jesd204_rx_avs_rst_n" internal="jesd204_rx_avs_rst_n" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_rx_dlb_data"
|
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internal="jesd204_0.jesd204_rx_dlb_data"
|
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|
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dir="end">
|
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|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_rx_dlb_data_valid"
|
||||
internal="jesd204_0.jesd204_rx_dlb_data_valid"
|
||||
type="conduit"
|
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dir="end">
|
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<port name="jesd204_rx_dlb_data_valid" internal="jesd204_rx_dlb_data_valid" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_rx_dlb_disperr"
|
||||
internal="jesd204_0.jesd204_rx_dlb_disperr"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="jesd204_rx_dlb_disperr" internal="jesd204_rx_dlb_disperr" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_rx_dlb_errdetect"
|
||||
internal="jesd204_0.jesd204_rx_dlb_errdetect"
|
||||
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|
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dir="end">
|
||||
<port name="jesd204_rx_dlb_errdetect" internal="jesd204_rx_dlb_errdetect" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_rx_dlb_kchar_data"
|
||||
internal="jesd204_0.jesd204_rx_dlb_kchar_data"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="jesd204_rx_dlb_kchar_data" internal="jesd204_rx_dlb_kchar_data" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_rx_frame_error"
|
||||
internal="jesd204_0.jesd204_rx_frame_error"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="jesd204_rx_frame_error" internal="jesd204_rx_frame_error" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_rx_int"
|
||||
internal="jesd204_0.jesd204_rx_int"
|
||||
type="interrupt"
|
||||
dir="end">
|
||||
<port name="jesd204_rx_int" internal="jesd204_rx_int" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_rx_link"
|
||||
internal="jesd204_0.jesd204_rx_link"
|
||||
type="avalon_streaming"
|
||||
dir="start">
|
||||
<port name="jesd204_rx_link_data" internal="jesd204_rx_link_data" />
|
||||
<port name="jesd204_rx_link_valid" internal="jesd204_rx_link_valid" />
|
||||
<port name="jesd204_rx_link_ready" internal="jesd204_rx_link_ready" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_rx_pcs_data"
|
||||
internal="jesd204_0.jesd204_rx_pcs_data"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="jesd204_rx_pcs_data" internal="jesd204_rx_pcs_data" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_rx_pcs_data_valid"
|
||||
internal="jesd204_0.jesd204_rx_pcs_data_valid"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="jesd204_rx_pcs_data_valid" internal="jesd204_rx_pcs_data_valid" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_rx_pcs_disperr"
|
||||
internal="jesd204_0.jesd204_rx_pcs_disperr"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="jesd204_rx_pcs_disperr" internal="jesd204_rx_pcs_disperr" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_rx_pcs_errdetect"
|
||||
internal="jesd204_0.jesd204_rx_pcs_errdetect"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="jesd204_rx_pcs_errdetect" internal="jesd204_rx_pcs_errdetect" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_rx_pcs_kchar_data"
|
||||
internal="jesd204_0.jesd204_rx_pcs_kchar_data"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="jesd204_rx_pcs_kchar_data" internal="jesd204_rx_pcs_kchar_data" />
|
||||
</interface>
|
||||
<interface
|
||||
name="patternalign_en"
|
||||
internal="jesd204_0.patternalign_en"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="patternalign_en" internal="patternalign_en" />
|
||||
</interface>
|
||||
<interface
|
||||
name="phy_csr_rx_pcfifo_empty"
|
||||
internal="jesd204_0.phy_csr_rx_pcfifo_empty"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="phy_csr_rx_pcfifo_empty" internal="phy_csr_rx_pcfifo_empty" />
|
||||
</interface>
|
||||
<interface
|
||||
name="phy_csr_rx_pcfifo_full"
|
||||
internal="jesd204_0.phy_csr_rx_pcfifo_full"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="phy_csr_rx_pcfifo_full" internal="phy_csr_rx_pcfifo_full" />
|
||||
</interface>
|
||||
<interface name="pll_ref_clk" internal="jesd204_0.pll_ref_clk" />
|
||||
<interface name="rx_analogreset" internal="jesd204_0.rx_analogreset" />
|
||||
<interface
|
||||
name="rx_cal_busy"
|
||||
internal="jesd204_0.rx_cal_busy"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="rx_cal_busy" internal="rx_cal_busy" />
|
||||
</interface>
|
||||
<interface name="rx_digitalreset" internal="jesd204_0.rx_digitalreset" />
|
||||
<interface
|
||||
name="rx_islockedtodata"
|
||||
internal="jesd204_0.rx_islockedtodata"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="rx_islockedtodata" internal="rx_islockedtodata" />
|
||||
</interface>
|
||||
<interface name="rx_serial_data" internal="jesd204_0.rx_serial_data" />
|
||||
<interface
|
||||
name="rxlink_clk"
|
||||
internal="jesd204_0.rxlink_clk"
|
||||
type="clock"
|
||||
dir="end">
|
||||
<port name="rxlink_clk" internal="rxlink_clk" />
|
||||
</interface>
|
||||
<interface
|
||||
name="rxlink_rst_n"
|
||||
internal="jesd204_0.rxlink_rst_n"
|
||||
type="reset"
|
||||
dir="end">
|
||||
<port name="rxlink_rst_n_reset_n" internal="rxlink_rst_n_reset_n" />
|
||||
</interface>
|
||||
<interface name="rxphy_clk" internal="jesd204_0.rxphy_clk" />
|
||||
<interface name="sof" internal="jesd204_0.sof" type="conduit" dir="end">
|
||||
<port name="sof" internal="sof" />
|
||||
</interface>
|
||||
<interface name="somf" internal="jesd204_0.somf" type="conduit" dir="end">
|
||||
<port name="somf" internal="somf" />
|
||||
</interface>
|
||||
<interface name="sysref" internal="jesd204_0.sysref" type="conduit" dir="end">
|
||||
<port name="sysref" internal="sysref" />
|
||||
</interface>
|
||||
<module
|
||||
name="jesd204_0"
|
||||
kind="altera_jesd204"
|
||||
version="15.0"
|
||||
enabled="1"
|
||||
autoexport="1">
|
||||
<parameter name="ADJCNT" value="0" />
|
||||
<parameter name="ADJDIR" value="0" />
|
||||
<parameter name="AUTO_DEVICE" value="10AX115S3F45I2SGE2" />
|
||||
<parameter name="AUTO_DEVICE_SPEEDGRADE" value="2" />
|
||||
<parameter name="BID" value="0" />
|
||||
<parameter name="CF" value="0" />
|
||||
<parameter name="CS" value="0" />
|
||||
<parameter name="DATA_PATH" value="RX" />
|
||||
<parameter name="DEVICE_FAMILY" value="Arria 10" />
|
||||
<parameter name="DID" value="0" />
|
||||
<parameter name="DLB_TEST" value="0" />
|
||||
<parameter name="ECC_EN" value="0" />
|
||||
<parameter name="GUI_CFG_F" value="1" />
|
||||
<parameter name="GUI_EN_CFG_F" value="true" />
|
||||
<parameter name="HD" value="1" />
|
||||
<parameter name="JESDV" value="1" />
|
||||
<parameter name="K" value="32" />
|
||||
<parameter name="L" value="4" />
|
||||
<parameter name="LID0" value="0" />
|
||||
<parameter name="LID1" value="1" />
|
||||
<parameter name="LID2" value="2" />
|
||||
<parameter name="LID3" value="3" />
|
||||
<parameter name="LID4" value="4" />
|
||||
<parameter name="LID5" value="5" />
|
||||
<parameter name="LID6" value="6" />
|
||||
<parameter name="LID7" value="7" />
|
||||
<parameter name="M" value="2" />
|
||||
<parameter name="N" value="16" />
|
||||
<parameter name="N_PRIME" value="16" />
|
||||
<parameter name="OPTIMIZE" value="0" />
|
||||
<parameter name="PCS_CONFIG" value="JESD_PCS_CFG1" />
|
||||
<parameter name="PHADJ" value="0" />
|
||||
<parameter name="REFCLK_FREQ" value="125.0" />
|
||||
<parameter name="RES1" value="0" />
|
||||
<parameter name="RES2" value="0" />
|
||||
<parameter name="S" value="1" />
|
||||
<parameter name="SCR" value="1" />
|
||||
<parameter name="SUBCLASSV" value="1" />
|
||||
<parameter name="TERMINATE_RECONFIG_EN" value="false" />
|
||||
<parameter name="TEST_COMPONENTS_EN" value="false" />
|
||||
<parameter name="bitrev_en" value="false" />
|
||||
<parameter name="bonded_mode" value="bonded" />
|
||||
<parameter name="lane_rate" value="10000.0" />
|
||||
<parameter name="part_trait_bd" value="NIGHTFURY5ES2" />
|
||||
<parameter name="part_trait_dp" value="10AX115S3F45I2SGE2" />
|
||||
<parameter name="pll_reconfig_enable" value="false" />
|
||||
<parameter name="pll_type" value="CMU" />
|
||||
<parameter name="rcfg_jtag_enable" value="false" />
|
||||
<parameter name="sdc_constraint" value="1.0" />
|
||||
<parameter name="set_capability_reg_enable" value="false" />
|
||||
<parameter name="set_csr_soft_logic_enable" value="false" />
|
||||
<parameter name="set_prbs_soft_logic_enable" value="false" />
|
||||
<parameter name="set_user_identifier" value="0" />
|
||||
<parameter name="wrapper_opt" value="base" />
|
||||
</module>
|
||||
<interconnectRequirement for="$system" name="qsys_mm.clockCrossingAdapter" value="HANDSHAKE" />
|
||||
<interconnectRequirement for="$system" name="qsys_mm.enableEccProtection" value="FALSE" />
|
||||
<interconnectRequirement for="$system" name="qsys_mm.insertDefaultSlave" value="FALSE" />
|
||||
<interconnectRequirement for="$system" name="qsys_mm.maxAdditionalLatency" value="1" />
|
||||
</system>
|
||||
|
|
@ -1,346 +0,0 @@
|
|||
<?xml version="1.0" encoding="UTF-8"?>
|
||||
<system name="$${FILENAME}">
|
||||
<component
|
||||
name="$${FILENAME}"
|
||||
displayName="$${FILENAME}"
|
||||
version="1.0"
|
||||
description=""
|
||||
tags="INTERNAL_COMPONENT=true"
|
||||
categories="" />
|
||||
<parameter name="bonusData"><![CDATA[bonusData
|
||||
{
|
||||
element $${FILENAME}
|
||||
{
|
||||
}
|
||||
element iopll_0
|
||||
{
|
||||
datum _sortIndex
|
||||
{
|
||||
value = "0";
|
||||
type = "int";
|
||||
}
|
||||
}
|
||||
}
|
||||
]]></parameter>
|
||||
<parameter name="clockCrossingAdapter" value="HANDSHAKE" />
|
||||
<parameter name="device" value="10AX115S3F45I2SGE2" />
|
||||
<parameter name="deviceFamily" value="Arria 10" />
|
||||
<parameter name="deviceSpeedGrade" value="2" />
|
||||
<parameter name="fabricMode" value="QSYS" />
|
||||
<parameter name="generateLegacySim" value="false" />
|
||||
<parameter name="generationId" value="0" />
|
||||
<parameter name="globalResetBus" value="false" />
|
||||
<parameter name="hdlLanguage" value="VERILOG" />
|
||||
<parameter name="hideFromIPCatalog" value="true" />
|
||||
<parameter name="lockedInterfaceDefinition" value="" />
|
||||
<parameter name="maxAdditionalLatency" value="1" />
|
||||
<parameter name="projectName" value="" />
|
||||
<parameter name="sopcBorderPoints" value="false" />
|
||||
<parameter name="systemHash" value="0" />
|
||||
<parameter name="testBenchDutName" value="" />
|
||||
<parameter name="timeStamp" value="0" />
|
||||
<parameter name="useTestBenchNamingPattern" value="false" />
|
||||
<instanceScript></instanceScript>
|
||||
<interface name="locked" internal="iopll_0.locked" type="conduit" dir="end">
|
||||
<port name="locked" internal="locked" />
|
||||
</interface>
|
||||
<interface name="outclk0" internal="iopll_0.outclk0" type="clock" dir="start">
|
||||
<port name="outclk_0" internal="outclk_0" />
|
||||
</interface>
|
||||
<interface name="refclk" internal="iopll_0.refclk" type="clock" dir="end">
|
||||
<port name="refclk" internal="refclk" />
|
||||
</interface>
|
||||
<interface name="reset" internal="iopll_0.reset" type="reset" dir="end">
|
||||
<port name="rst" internal="rst" />
|
||||
</interface>
|
||||
<module
|
||||
name="iopll_0"
|
||||
kind="altera_iopll"
|
||||
version="15.0"
|
||||
enabled="1"
|
||||
autoexport="1">
|
||||
<parameter name="gui_active_clk" value="false" />
|
||||
<parameter name="gui_actual_duty_cycle0" value="50.0" />
|
||||
<parameter name="gui_actual_duty_cycle1" value="50.0" />
|
||||
<parameter name="gui_actual_duty_cycle10" value="50.0" />
|
||||
<parameter name="gui_actual_duty_cycle11" value="50.0" />
|
||||
<parameter name="gui_actual_duty_cycle12" value="50.0" />
|
||||
<parameter name="gui_actual_duty_cycle13" value="50.0" />
|
||||
<parameter name="gui_actual_duty_cycle14" value="50.0" />
|
||||
<parameter name="gui_actual_duty_cycle15" value="50.0" />
|
||||
<parameter name="gui_actual_duty_cycle16" value="50.0" />
|
||||
<parameter name="gui_actual_duty_cycle17" value="50.0" />
|
||||
<parameter name="gui_actual_duty_cycle2" value="50.0" />
|
||||
<parameter name="gui_actual_duty_cycle3" value="50.0" />
|
||||
<parameter name="gui_actual_duty_cycle4" value="50.0" />
|
||||
<parameter name="gui_actual_duty_cycle5" value="50.0" />
|
||||
<parameter name="gui_actual_duty_cycle6" value="50.0" />
|
||||
<parameter name="gui_actual_duty_cycle7" value="50.0" />
|
||||
<parameter name="gui_actual_duty_cycle8" value="50.0" />
|
||||
<parameter name="gui_actual_duty_cycle9" value="50.0" />
|
||||
<parameter name="gui_actual_output_clock_frequency0" value="100.0" />
|
||||
<parameter name="gui_actual_output_clock_frequency1" value="100.0" />
|
||||
<parameter name="gui_actual_output_clock_frequency10" value="100.0" />
|
||||
<parameter name="gui_actual_output_clock_frequency11" value="100.0" />
|
||||
<parameter name="gui_actual_output_clock_frequency12" value="100.0" />
|
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<parameter name="gui_actual_output_clock_frequency13" value="100.0" />
|
||||
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|
||||
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|
||||
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|
||||
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|
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<parameter name="gui_actual_output_clock_frequency2" value="100.0" />
|
||||
<parameter name="gui_actual_output_clock_frequency3" value="100.0" />
|
||||
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|
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|
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|
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|
||||
<parameter name="gui_actual_output_clock_frequency8" value="100.0" />
|
||||
<parameter name="gui_actual_output_clock_frequency9" value="100.0" />
|
||||
<parameter name="gui_actual_phase_shift0" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift1" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift10" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift11" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift12" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift13" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift14" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift15" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift16" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift17" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift2" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift3" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift4" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift5" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift6" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift7" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift8" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift9" value="0.0" />
|
||||
<parameter name="gui_actual_phase_shift_deg0" value="0.0" />
|
||||
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|
||||
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|
||||
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|
||||
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|
||||
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|
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|
||||
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|
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|
||||
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|
||||
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|
||||
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|
||||
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|
||||
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|
||||
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|
||||
<parameter name="gui_actual_phase_shift_deg7" value="0.0" />
|
||||
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|
||||
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|
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<parameter name="gui_cascade_counter0" value="false" />
|
||||
<parameter name="gui_cascade_counter1" value="false" />
|
||||
<parameter name="gui_cascade_counter10" value="false" />
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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<parameter name="gui_cascade_outclk_index" value="0" />
|
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<parameter name="gui_clk_bad" value="false" />
|
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|
||||
<parameter name="gui_clock_name_global1" value="false" />
|
||||
<parameter name="gui_clock_name_global10" value="false" />
|
||||
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|
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|
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|
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|
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<parameter name="gui_switchover_mode">Automatic Switchover</parameter>
|
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|
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|
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|
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|
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|
||||
</module>
|
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|
||||
</system>
|
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|
|
@ -1,405 +0,0 @@
|
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<?xml version="1.0" encoding="UTF-8"?>
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<system name="$${FILENAME}">
|
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<component
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description=""
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tags="INTERNAL_COMPONENT=true"
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categories="" />
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<parameter name="bonusData"><![CDATA[bonusData
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element $${FILENAME}
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||||
element jesd204_0
|
||||
{
|
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datum _sortIndex
|
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{
|
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|
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}
|
||||
}
|
||||
}
|
||||
]]></parameter>
|
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<parameter name="clockCrossingAdapter" value="HANDSHAKE" />
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<parameter name="device" value="10AX115S3F45I2SGE2" />
|
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<parameter name="deviceFamily" value="Arria 10" />
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|
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<parameter name="timeStamp" value="0" />
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<instanceScript></instanceScript>
|
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<interface name="alldev_lane_aligned" internal="jesd204_0.alldev_lane_aligned" />
|
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<interface
|
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name="csr_bit_reversal"
|
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internal="jesd204_0.csr_bit_reversal"
|
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|
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dir="end">
|
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|
||||
</interface>
|
||||
<interface
|
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|
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|
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|
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dir="end">
|
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|
||||
</interface>
|
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|
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|
||||
</interface>
|
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<interface name="csr_cs" internal="jesd204_0.csr_cs" type="conduit" dir="end">
|
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|
||||
</interface>
|
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|
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|
||||
</interface>
|
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<interface name="csr_hd" internal="jesd204_0.csr_hd" type="conduit" dir="end">
|
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|
||||
</interface>
|
||||
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|
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|
||||
</interface>
|
||||
<interface name="csr_l" internal="jesd204_0.csr_l" type="conduit" dir="end">
|
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|
||||
</interface>
|
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<interface
|
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|
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internal="jesd204_0.csr_lane_polarity"
|
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|
||||
dir="end">
|
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<port name="csr_lane_polarity" internal="csr_lane_polarity" />
|
||||
</interface>
|
||||
<interface
|
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name="csr_lane_powerdown"
|
||||
internal="jesd204_0.csr_lane_powerdown"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="csr_lane_powerdown" internal="csr_lane_powerdown" />
|
||||
</interface>
|
||||
<interface name="csr_m" internal="jesd204_0.csr_m" type="conduit" dir="end">
|
||||
<port name="csr_m" internal="csr_m" />
|
||||
</interface>
|
||||
<interface name="csr_n" internal="jesd204_0.csr_n" type="conduit" dir="end">
|
||||
<port name="csr_n" internal="csr_n" />
|
||||
</interface>
|
||||
<interface name="csr_np" internal="jesd204_0.csr_np" type="conduit" dir="end">
|
||||
<port name="csr_np" internal="csr_np" />
|
||||
</interface>
|
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<interface name="csr_rx_testmode" internal="jesd204_0.csr_rx_testmode" />
|
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<interface name="csr_s" internal="jesd204_0.csr_s" type="conduit" dir="end">
|
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|
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</interface>
|
||||
<interface
|
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|
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internal="jesd204_0.csr_tx_testmode"
|
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|
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|
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|
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</interface>
|
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<interface
|
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|
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internal="jesd204_0.csr_tx_testpattern_a"
|
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|
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dir="end">
|
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<port name="csr_tx_testpattern_a" internal="csr_tx_testpattern_a" />
|
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</interface>
|
||||
<interface
|
||||
name="csr_tx_testpattern_b"
|
||||
internal="jesd204_0.csr_tx_testpattern_b"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="csr_tx_testpattern_b" internal="csr_tx_testpattern_b" />
|
||||
</interface>
|
||||
<interface
|
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name="csr_tx_testpattern_c"
|
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internal="jesd204_0.csr_tx_testpattern_c"
|
||||
type="conduit"
|
||||
dir="end">
|
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<port name="csr_tx_testpattern_c" internal="csr_tx_testpattern_c" />
|
||||
</interface>
|
||||
<interface
|
||||
name="csr_tx_testpattern_d"
|
||||
internal="jesd204_0.csr_tx_testpattern_d"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="csr_tx_testpattern_d" internal="csr_tx_testpattern_d" />
|
||||
</interface>
|
||||
<interface name="dev_lane_aligned" internal="jesd204_0.dev_lane_aligned" />
|
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<interface
|
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name="dev_sync_n"
|
||||
internal="jesd204_0.dev_sync_n"
|
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type="conduit"
|
||||
dir="end">
|
||||
<port name="dev_sync_n" internal="dev_sync_n" />
|
||||
</interface>
|
||||
<interface name="jesd204_rx_avs" internal="jesd204_0.jesd204_rx_avs" />
|
||||
<interface name="jesd204_rx_avs_clk" internal="jesd204_0.jesd204_rx_avs_clk" />
|
||||
<interface name="jesd204_rx_avs_rst_n" internal="jesd204_0.jesd204_rx_avs_rst_n" />
|
||||
<interface name="jesd204_rx_dlb_data" internal="jesd204_0.jesd204_rx_dlb_data" />
|
||||
<interface
|
||||
name="jesd204_rx_dlb_data_valid"
|
||||
internal="jesd204_0.jesd204_rx_dlb_data_valid" />
|
||||
<interface
|
||||
name="jesd204_rx_dlb_disperr"
|
||||
internal="jesd204_0.jesd204_rx_dlb_disperr" />
|
||||
<interface
|
||||
name="jesd204_rx_dlb_errdetect"
|
||||
internal="jesd204_0.jesd204_rx_dlb_errdetect" />
|
||||
<interface
|
||||
name="jesd204_rx_dlb_kchar_data"
|
||||
internal="jesd204_0.jesd204_rx_dlb_kchar_data" />
|
||||
<interface
|
||||
name="jesd204_rx_frame_error"
|
||||
internal="jesd204_0.jesd204_rx_frame_error" />
|
||||
<interface name="jesd204_rx_int" internal="jesd204_0.jesd204_rx_int" />
|
||||
<interface name="jesd204_rx_link" internal="jesd204_0.jesd204_rx_link" />
|
||||
<interface name="jesd204_rx_pcs_data" internal="jesd204_0.jesd204_rx_pcs_data" />
|
||||
<interface
|
||||
name="jesd204_rx_pcs_data_valid"
|
||||
internal="jesd204_0.jesd204_rx_pcs_data_valid" />
|
||||
<interface
|
||||
name="jesd204_rx_pcs_disperr"
|
||||
internal="jesd204_0.jesd204_rx_pcs_disperr" />
|
||||
<interface
|
||||
name="jesd204_rx_pcs_errdetect"
|
||||
internal="jesd204_0.jesd204_rx_pcs_errdetect" />
|
||||
<interface
|
||||
name="jesd204_rx_pcs_kchar_data"
|
||||
internal="jesd204_0.jesd204_rx_pcs_kchar_data" />
|
||||
<interface
|
||||
name="jesd204_tx_avs"
|
||||
internal="jesd204_0.jesd204_tx_avs"
|
||||
type="avalon"
|
||||
dir="end">
|
||||
<port name="jesd204_tx_avs_chipselect" internal="jesd204_tx_avs_chipselect" />
|
||||
<port name="jesd204_tx_avs_address" internal="jesd204_tx_avs_address" />
|
||||
<port name="jesd204_tx_avs_read" internal="jesd204_tx_avs_read" />
|
||||
<port name="jesd204_tx_avs_readdata" internal="jesd204_tx_avs_readdata" />
|
||||
<port
|
||||
name="jesd204_tx_avs_waitrequest"
|
||||
internal="jesd204_tx_avs_waitrequest" />
|
||||
<port name="jesd204_tx_avs_write" internal="jesd204_tx_avs_write" />
|
||||
<port name="jesd204_tx_avs_writedata" internal="jesd204_tx_avs_writedata" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_tx_avs_clk"
|
||||
internal="jesd204_0.jesd204_tx_avs_clk"
|
||||
type="clock"
|
||||
dir="end">
|
||||
<port name="jesd204_tx_avs_clk" internal="jesd204_tx_avs_clk" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_tx_avs_rst_n"
|
||||
internal="jesd204_0.jesd204_tx_avs_rst_n"
|
||||
type="reset"
|
||||
dir="end">
|
||||
<port name="jesd204_tx_avs_rst_n" internal="jesd204_tx_avs_rst_n" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_tx_frame_error"
|
||||
internal="jesd204_0.jesd204_tx_frame_error"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="jesd204_tx_frame_error" internal="jesd204_tx_frame_error" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_tx_frame_ready"
|
||||
internal="jesd204_0.jesd204_tx_frame_ready"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="jesd204_tx_frame_ready" internal="jesd204_tx_frame_ready" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_tx_int"
|
||||
internal="jesd204_0.jesd204_tx_int"
|
||||
type="interrupt"
|
||||
dir="end">
|
||||
<port name="jesd204_tx_int" internal="jesd204_tx_int" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_tx_link"
|
||||
internal="jesd204_0.jesd204_tx_link"
|
||||
type="avalon_streaming"
|
||||
dir="end">
|
||||
<port name="jesd204_tx_link_data" internal="jesd204_tx_link_data" />
|
||||
<port name="jesd204_tx_link_valid" internal="jesd204_tx_link_valid" />
|
||||
<port name="jesd204_tx_link_ready" internal="jesd204_tx_link_ready" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_tx_pcs_data"
|
||||
internal="jesd204_0.jesd204_tx_pcs_data"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="jesd204_tx_pcs_data" internal="jesd204_tx_pcs_data" />
|
||||
</interface>
|
||||
<interface
|
||||
name="jesd204_tx_pcs_kchar_data"
|
||||
internal="jesd204_0.jesd204_tx_pcs_kchar_data"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="jesd204_tx_pcs_kchar_data" internal="jesd204_tx_pcs_kchar_data" />
|
||||
</interface>
|
||||
<interface
|
||||
name="mdev_sync_n"
|
||||
internal="jesd204_0.mdev_sync_n"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="mdev_sync_n" internal="mdev_sync_n" />
|
||||
</interface>
|
||||
<interface name="patternalign_en" internal="jesd204_0.patternalign_en" />
|
||||
<interface
|
||||
name="phy_csr_rx_pcfifo_empty"
|
||||
internal="jesd204_0.phy_csr_rx_pcfifo_empty" />
|
||||
<interface
|
||||
name="phy_csr_rx_pcfifo_full"
|
||||
internal="jesd204_0.phy_csr_rx_pcfifo_full" />
|
||||
<interface
|
||||
name="phy_csr_tx_pcfifo_empty"
|
||||
internal="jesd204_0.phy_csr_tx_pcfifo_empty"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="phy_csr_tx_pcfifo_empty" internal="phy_csr_tx_pcfifo_empty" />
|
||||
</interface>
|
||||
<interface
|
||||
name="phy_csr_tx_pcfifo_full"
|
||||
internal="jesd204_0.phy_csr_tx_pcfifo_full"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="phy_csr_tx_pcfifo_full" internal="phy_csr_tx_pcfifo_full" />
|
||||
</interface>
|
||||
<interface
|
||||
name="phy_tx_elecidle"
|
||||
internal="jesd204_0.phy_tx_elecidle"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="phy_tx_elecidle" internal="phy_tx_elecidle" />
|
||||
</interface>
|
||||
<interface
|
||||
name="pll_locked"
|
||||
internal="jesd204_0.pll_locked"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="pll_locked" internal="pll_locked" />
|
||||
</interface>
|
||||
<interface name="pll_ref_clk" internal="jesd204_0.pll_ref_clk" />
|
||||
<interface name="rx_analogreset" internal="jesd204_0.rx_analogreset" />
|
||||
<interface name="rx_cal_busy" internal="jesd204_0.rx_cal_busy" />
|
||||
<interface name="rx_digitalreset" internal="jesd204_0.rx_digitalreset" />
|
||||
<interface name="rx_islockedtodata" internal="jesd204_0.rx_islockedtodata" />
|
||||
<interface name="rx_serial_data" internal="jesd204_0.rx_serial_data" />
|
||||
<interface name="rxlink_clk" internal="jesd204_0.rxlink_clk" />
|
||||
<interface name="rxlink_rst_n" internal="jesd204_0.rxlink_rst_n" />
|
||||
<interface name="rxphy_clk" internal="jesd204_0.rxphy_clk" />
|
||||
<interface name="sof" internal="jesd204_0.sof" />
|
||||
<interface name="somf" internal="jesd204_0.somf" />
|
||||
<interface name="sync_n" internal="jesd204_0.sync_n" type="conduit" dir="end">
|
||||
<port name="sync_n" internal="sync_n" />
|
||||
</interface>
|
||||
<interface name="sysref" internal="jesd204_0.sysref" type="conduit" dir="end">
|
||||
<port name="sysref" internal="sysref" />
|
||||
</interface>
|
||||
<interface name="tx_analogreset" internal="jesd204_0.tx_analogreset" />
|
||||
<interface name="tx_bonding_clocks" internal="jesd204_0.tx_bonding_clocks" />
|
||||
<interface
|
||||
name="tx_cal_busy"
|
||||
internal="jesd204_0.tx_cal_busy"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="tx_cal_busy" internal="tx_cal_busy" />
|
||||
</interface>
|
||||
<interface name="tx_digitalreset" internal="jesd204_0.tx_digitalreset" />
|
||||
<interface name="tx_serial_clk0" internal="jesd204_0.tx_serial_clk0" />
|
||||
<interface name="tx_serial_data" internal="jesd204_0.tx_serial_data" />
|
||||
<interface
|
||||
name="txlink_clk"
|
||||
internal="jesd204_0.txlink_clk"
|
||||
type="clock"
|
||||
dir="end">
|
||||
<port name="txlink_clk" internal="txlink_clk" />
|
||||
</interface>
|
||||
<interface
|
||||
name="txlink_rst_n"
|
||||
internal="jesd204_0.txlink_rst_n"
|
||||
type="reset"
|
||||
dir="end">
|
||||
<port name="txlink_rst_n_reset_n" internal="txlink_rst_n_reset_n" />
|
||||
</interface>
|
||||
<interface name="txphy_clk" internal="jesd204_0.txphy_clk" />
|
||||
<module
|
||||
name="jesd204_0"
|
||||
kind="altera_jesd204"
|
||||
version="15.0"
|
||||
enabled="1"
|
||||
autoexport="1">
|
||||
<parameter name="ADJCNT" value="0" />
|
||||
<parameter name="ADJDIR" value="0" />
|
||||
<parameter name="AUTO_DEVICE" value="10AX115S3F45I2SGE2" />
|
||||
<parameter name="AUTO_DEVICE_SPEEDGRADE" value="2" />
|
||||
<parameter name="BID" value="0" />
|
||||
<parameter name="CF" value="0" />
|
||||
<parameter name="CS" value="0" />
|
||||
<parameter name="DATA_PATH" value="TX" />
|
||||
<parameter name="DEVICE_FAMILY" value="Arria 10" />
|
||||
<parameter name="DID" value="0" />
|
||||
<parameter name="DLB_TEST" value="0" />
|
||||
<parameter name="ECC_EN" value="0" />
|
||||
<parameter name="GUI_CFG_F" value="1" />
|
||||
<parameter name="GUI_EN_CFG_F" value="true" />
|
||||
<parameter name="HD" value="1" />
|
||||
<parameter name="JESDV" value="1" />
|
||||
<parameter name="K" value="32" />
|
||||
<parameter name="L" value="4" />
|
||||
<parameter name="LID0" value="0" />
|
||||
<parameter name="LID1" value="1" />
|
||||
<parameter name="LID2" value="2" />
|
||||
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|
||||
<parameter name="LID4" value="4" />
|
||||
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|
||||
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|
||||
<parameter name="LID7" value="7" />
|
||||
<parameter name="M" value="2" />
|
||||
<parameter name="N" value="16" />
|
||||
<parameter name="N_PRIME" value="16" />
|
||||
<parameter name="OPTIMIZE" value="0" />
|
||||
<parameter name="PCS_CONFIG" value="JESD_PCS_CFG1" />
|
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<parameter name="PHADJ" value="0" />
|
||||
<parameter name="REFCLK_FREQ" value="125.0" />
|
||||
<parameter name="RES1" value="0" />
|
||||
<parameter name="RES2" value="0" />
|
||||
<parameter name="S" value="1" />
|
||||
<parameter name="SCR" value="1" />
|
||||
<parameter name="SUBCLASSV" value="1" />
|
||||
<parameter name="TERMINATE_RECONFIG_EN" value="false" />
|
||||
<parameter name="TEST_COMPONENTS_EN" value="false" />
|
||||
<parameter name="bitrev_en" value="false" />
|
||||
<parameter name="bonded_mode" value="non_bonded" />
|
||||
<parameter name="lane_rate" value="10000.0" />
|
||||
<parameter name="part_trait_bd" value="NIGHTFURY5ES2" />
|
||||
<parameter name="part_trait_dp" value="10AX115S3F45I2SGE2" />
|
||||
<parameter name="pll_reconfig_enable" value="false" />
|
||||
<parameter name="pll_type" value="CMU" />
|
||||
<parameter name="rcfg_jtag_enable" value="false" />
|
||||
<parameter name="sdc_constraint" value="1.0" />
|
||||
<parameter name="set_capability_reg_enable" value="false" />
|
||||
<parameter name="set_csr_soft_logic_enable" value="false" />
|
||||
<parameter name="set_prbs_soft_logic_enable" value="false" />
|
||||
<parameter name="set_user_identifier" value="0" />
|
||||
<parameter name="wrapper_opt" value="base" />
|
||||
</module>
|
||||
<interconnectRequirement for="$system" name="qsys_mm.clockCrossingAdapter" value="HANDSHAKE" />
|
||||
<interconnectRequirement for="$system" name="qsys_mm.enableEccProtection" value="FALSE" />
|
||||
<interconnectRequirement for="$system" name="qsys_mm.insertDefaultSlave" value="FALSE" />
|
||||
<interconnectRequirement for="$system" name="qsys_mm.maxAdditionalLatency" value="1" />
|
||||
</system>
|
||||
|
|
@ -1,151 +0,0 @@
|
|||
<?xml version="1.0" encoding="UTF-8"?>
|
||||
<system name="$${FILENAME}">
|
||||
<component
|
||||
name="$${FILENAME}"
|
||||
displayName="$${FILENAME}"
|
||||
version="1.0"
|
||||
description=""
|
||||
tags="INTERNAL_COMPONENT=true"
|
||||
categories="" />
|
||||
<parameter name="bonusData"><![CDATA[bonusData
|
||||
{
|
||||
element $${FILENAME}
|
||||
{
|
||||
}
|
||||
element xcvr_atx_pll_a10_0
|
||||
{
|
||||
datum _sortIndex
|
||||
{
|
||||
value = "0";
|
||||
type = "int";
|
||||
}
|
||||
}
|
||||
}
|
||||
]]></parameter>
|
||||
<parameter name="clockCrossingAdapter" value="HANDSHAKE" />
|
||||
<parameter name="device" value="10AX115S3F45I2SGE2" />
|
||||
<parameter name="deviceFamily" value="Arria 10" />
|
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<parameter name="deviceSpeedGrade" value="2" />
|
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<parameter name="fabricMode" value="QSYS" />
|
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<parameter name="generateLegacySim" value="false" />
|
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<parameter name="generationId" value="0" />
|
||||
<parameter name="globalResetBus" value="false" />
|
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<parameter name="hdlLanguage" value="VERILOG" />
|
||||
<parameter name="hideFromIPCatalog" value="true" />
|
||||
<parameter name="lockedInterfaceDefinition" value="" />
|
||||
<parameter name="maxAdditionalLatency" value="1" />
|
||||
<parameter name="projectName" value="" />
|
||||
<parameter name="sopcBorderPoints" value="false" />
|
||||
<parameter name="systemHash" value="0" />
|
||||
<parameter name="testBenchDutName" value="" />
|
||||
<parameter name="timeStamp" value="0" />
|
||||
<parameter name="useTestBenchNamingPattern" value="false" />
|
||||
<instanceScript></instanceScript>
|
||||
<interface
|
||||
name="pll_cal_busy"
|
||||
internal="xcvr_atx_pll_a10_0.pll_cal_busy"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="pll_cal_busy" internal="pll_cal_busy" />
|
||||
</interface>
|
||||
<interface
|
||||
name="pll_locked"
|
||||
internal="xcvr_atx_pll_a10_0.pll_locked"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="pll_locked" internal="pll_locked" />
|
||||
</interface>
|
||||
<interface
|
||||
name="pll_powerdown"
|
||||
internal="xcvr_atx_pll_a10_0.pll_powerdown"
|
||||
type="conduit"
|
||||
dir="end">
|
||||
<port name="pll_powerdown" internal="pll_powerdown" />
|
||||
</interface>
|
||||
<interface
|
||||
name="pll_refclk0"
|
||||
internal="xcvr_atx_pll_a10_0.pll_refclk0"
|
||||
type="clock"
|
||||
dir="end">
|
||||
<port name="pll_refclk0" internal="pll_refclk0" />
|
||||
</interface>
|
||||
<interface
|
||||
name="tx_serial_clk"
|
||||
internal="xcvr_atx_pll_a10_0.tx_serial_clk"
|
||||
type="hssi_serial_clock"
|
||||
dir="start">
|
||||
<port name="tx_serial_clk" internal="tx_serial_clk" />
|
||||
</interface>
|
||||
<module
|
||||
name="xcvr_atx_pll_a10_0"
|
||||
kind="altera_xcvr_atx_pll_a10"
|
||||
version="15.0"
|
||||
enabled="1"
|
||||
autoexport="1">
|
||||
<parameter name="base_device" value="NIGHTFURY5ES2" />
|
||||
<parameter name="bw_sel" value="medium" />
|
||||
<parameter name="device" value="10AX115S3F45I2SGE2" />
|
||||
<parameter name="device_family" value="Arria 10" />
|
||||
<parameter name="enable_16G_path" value="0" />
|
||||
<parameter name="enable_8G_path" value="1" />
|
||||
<parameter name="enable_atx_to_fpll_cascade_out" value="0" />
|
||||
<parameter name="enable_bonding_clks" value="0" />
|
||||
<parameter name="enable_cascade_out" value="0" />
|
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<parameter name="enable_debug_ports_parameters" value="0" />
|
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<parameter name="enable_fb_comp_bonding" value="0" />
|
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<parameter name="enable_fractional" value="0" />
|
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<parameter name="enable_hfreq_clk" value="0" />
|
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<parameter name="enable_hip_cal_done_port" value="0" />
|
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<parameter name="enable_manual_configuration" value="1" />
|
||||
<parameter name="enable_mcgb" value="0" />
|
||||
<parameter name="enable_mcgb_pcie_clksw" value="0" />
|
||||
<parameter name="enable_pcie_clk" value="0" />
|
||||
<parameter name="enable_pld_atx_cal_busy_port" value="1" />
|
||||
<parameter name="enable_pld_mcgb_cal_busy_port" value="0" />
|
||||
<parameter name="enable_pll_reconfig" value="0" />
|
||||
<parameter name="generate_add_hdl_instance_example" value="0" />
|
||||
<parameter name="generate_docs" value="1" />
|
||||
<parameter name="mcgb_aux_clkin_cnt" value="0" />
|
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<parameter name="mcgb_div" value="1" />
|
||||
<parameter name="message_level" value="error" />
|
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<parameter name="pma_width" value="64" />
|
||||
<parameter name="primary_pll_buffer">GX clock output buffer</parameter>
|
||||
<parameter name="prot_mode" value="Basic" />
|
||||
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|
||||
<parameter name="rcfg_file_prefix">altera_xcvr_atx_pll_a10</parameter>
|
||||
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
||||
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|
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|
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|
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|
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|
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|
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|
||||
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|
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<parameter name="set_hip_cal_en" value="0" />
|
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|
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<parameter name="set_l_cascade_counter" value="4" />
|
||||
<parameter name="set_l_counter" value="4" />
|
||||
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|
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|
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|
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|
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|
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|
||||
<parameter name="support_mode" value="user_mode" />
|
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|
||||
</module>
|
||||
<interconnectRequirement for="$system" name="qsys_mm.clockCrossingAdapter" value="HANDSHAKE" />
|
||||
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|
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|
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|
||||
</system>
|
||||
|
|
@ -1,346 +0,0 @@
|
|||
<?xml version="1.0" encoding="UTF-8"?>
|
||||
<system name="$${FILENAME}">
|
||||
<component
|
||||
name="$${FILENAME}"
|
||||
displayName="$${FILENAME}"
|
||||
version="1.0"
|
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description=""
|
||||
tags="INTERNAL_COMPONENT=true"
|
||||
categories="" />
|
||||
<parameter name="bonusData"><![CDATA[bonusData
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||||
{
|
||||
element $${FILENAME}
|
||||
{
|
||||
}
|
||||
element iopll_0
|
||||
{
|
||||
datum _sortIndex
|
||||
{
|
||||
value = "0";
|
||||
type = "int";
|
||||
}
|
||||
}
|
||||
}
|
||||
]]></parameter>
|
||||
<parameter name="clockCrossingAdapter" value="HANDSHAKE" />
|
||||
<parameter name="device" value="10AX115S3F45I2SGE2" />
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
||||
<instanceScript></instanceScript>
|
||||
<interface name="locked" internal="iopll_0.locked" type="conduit" dir="end">
|
||||
<port name="locked" internal="locked" />
|
||||
</interface>
|
||||
<interface name="outclk0" internal="iopll_0.outclk0" type="clock" dir="start">
|
||||
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|
||||
</interface>
|
||||
<interface name="refclk" internal="iopll_0.refclk" type="clock" dir="end">
|
||||
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|
||||
</interface>
|
||||
<interface name="reset" internal="iopll_0.reset" type="reset" dir="end">
|
||||
<port name="rst" internal="rst" />
|
||||
</interface>
|
||||
<module
|
||||
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|
||||
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|
||||
version="15.0"
|
||||
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|
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|
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|
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|
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|
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|
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|
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|
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||||
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|
||||
<parameter name="gui_output_clock_frequency12" value="100.0" />
|
||||
<parameter name="gui_output_clock_frequency13" value="100.0" />
|
||||
<parameter name="gui_output_clock_frequency14" value="100.0" />
|
||||
<parameter name="gui_output_clock_frequency15" value="100.0" />
|
||||
<parameter name="gui_output_clock_frequency16" value="100.0" />
|
||||
<parameter name="gui_output_clock_frequency17" value="100.0" />
|
||||
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<parameter name="gui_switchover_mode">Automatic Switchover</parameter>
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<parameter name="system_info_device_component" value="10AX115S3F45I2SGE2" />
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<parameter name="system_info_device_family" value="Arria 10" />
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<parameter name="system_part_trait_speed_grade" value="2" />
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</module>
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<interconnectRequirement for="$system" name="qsys_mm.clockCrossingAdapter" value="HANDSHAKE" />
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<interconnectRequirement for="$system" name="qsys_mm.enableEccProtection" value="FALSE" />
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<interconnectRequirement for="$system" name="qsys_mm.insertDefaultSlave" value="FALSE" />
|
||||
<interconnectRequirement for="$system" name="qsys_mm.maxAdditionalLatency" value="1" />
|
||||
</system>
|
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