util_adxcvr: Add PPF1_CFG parameter
parent
eba3409d78
commit
ef69fe36db
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@ -55,6 +55,7 @@ module util_adxcvr #(
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parameter integer QPLL_FBDIV_RATIO = 1,
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parameter [15:0] POR_CFG = 16'b0000000000000110,
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parameter [15:0] PPF0_CFG = 16'b0000011000000000,
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parameter [15:0] PPF1_CFG = 16'b0000011000000000,
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parameter [26:0] QPLL_CFG = 27'h0680181,
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parameter [ 9:0] QPLL_FBDIV = 10'b0000110000,
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parameter [15:0] QPLL_CFG0 = 16'b0011001100011100,
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@ -1308,6 +1309,7 @@ module util_adxcvr #(
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.QPLL_FBDIV_RATIO (QPLL_FBDIV_RATIO),
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.POR_CFG (POR_CFG),
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.PPF0_CFG (PPF0_CFG),
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.PPF1_CFG (PPF1_CFG),
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.QPLL_CFG (QPLL_CFG),
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.QPLL_FBDIV (QPLL_FBDIV),
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.QPLL_CFG0 (QPLL_CFG0),
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@ -1937,6 +1939,7 @@ module util_adxcvr #(
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.QPLL_FBDIV_RATIO (QPLL_FBDIV_RATIO),
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.POR_CFG (POR_CFG),
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.PPF0_CFG (PPF0_CFG),
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.PPF1_CFG (PPF1_CFG),
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.QPLL_CFG (QPLL_CFG),
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.QPLL_FBDIV (QPLL_FBDIV),
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.QPLL_CFG0 (QPLL_CFG0),
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@ -2566,6 +2569,7 @@ module util_adxcvr #(
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.QPLL_FBDIV_RATIO (QPLL_FBDIV_RATIO),
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.POR_CFG (POR_CFG),
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.PPF0_CFG (PPF0_CFG),
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.PPF1_CFG (PPF1_CFG),
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.QPLL_CFG (QPLL_CFG),
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.QPLL_FBDIV (QPLL_FBDIV),
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.QPLL_CFG0 (QPLL_CFG0),
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@ -3195,6 +3199,7 @@ module util_adxcvr #(
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.QPLL_FBDIV_RATIO (QPLL_FBDIV_RATIO),
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.POR_CFG (POR_CFG),
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.PPF0_CFG (PPF0_CFG),
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.PPF1_CFG (PPF1_CFG),
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.QPLL_CFG (QPLL_CFG),
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.QPLL_FBDIV (QPLL_FBDIV),
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.QPLL_CFG0 (QPLL_CFG0),
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@ -44,6 +44,7 @@ module util_adxcvr_xcm #(
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parameter integer QPLL_FBDIV_RATIO = 1,
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parameter [15:0] POR_CFG = 16'b0000000000000110,
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||||
parameter [15:0] PPF0_CFG = 16'b0000011000000000,
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||||
parameter [15:0] PPF1_CFG = 16'b0000011000000000,
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||||
parameter [26:0] QPLL_CFG = 27'h0680181,
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parameter [ 9:0] QPLL_FBDIV = 10'b0000110000,
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parameter [15:0] QPLL_CFG0 = 16'b0011001100011100,
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@ -382,7 +383,7 @@ module util_adxcvr_xcm #(
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.COMMON_CFG1 (16'b0000000000000000),
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.POR_CFG (POR_CFG),
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.PPF0_CFG (PPF0_CFG),
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.PPF1_CFG (16'b0000011000000000),
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.PPF1_CFG (PPF1_CFG),
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.QPLL0CLKOUT_RATE ("HALF"),
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.QPLL0_CFG0 (QPLL_CFG0),
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.QPLL0_CFG1 (QPLL_CFG1),
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@ -557,7 +558,7 @@ module util_adxcvr_xcm #(
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.COMMON_CFG1 (16'b0000000000000000),
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.POR_CFG (16'b0000000000000000),
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.PPF0_CFG (PPF0_CFG),
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.PPF1_CFG (16'b0000011000000000),
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.PPF1_CFG (PPF1_CFG),
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.QPLL0CLKOUT_RATE ("HALF"),
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.QPLL0_CFG0 (QPLL_CFG0),
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.QPLL0_CFG1 (QPLL_CFG1),
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