rfifo- drive valid outs
parent
cd07ee80aa
commit
bb660d8cf8
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@ -141,6 +141,7 @@ module util_rfifo #(
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reg din_req = 'd0;
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reg din_init = 'd0;
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reg din_unf_d = 'd0;
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reg [ 7:0] dout_valid = 'd0;
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reg [(T_DOUT_DATA_WIDTH+1):0] dout_data = 'd0;
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reg [(DATA_WIDTH-1):0] dout_rdata = 'd0;
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reg [ 7:0] dout_enable = 'd0;
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@ -294,6 +295,15 @@ module util_rfifo #(
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end
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endgenerate
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assign dout_valid_out_7 = dout_valid[7];
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assign dout_valid_out_6 = dout_valid[6];
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assign dout_valid_out_5 = dout_valid[5];
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assign dout_valid_out_4 = dout_valid[4];
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assign dout_valid_out_3 = dout_valid[3];
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||||
assign dout_valid_out_2 = dout_valid[2];
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assign dout_valid_out_1 = dout_valid[1];
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assign dout_valid_out_0 = dout_valid[0];
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assign dout_data_7 = dout_data[((DOUT_DATA_WIDTH*8)-1):(DOUT_DATA_WIDTH*7)];
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||||
assign dout_data_6 = dout_data[((DOUT_DATA_WIDTH*7)-1):(DOUT_DATA_WIDTH*6)];
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||||
assign dout_data_5 = dout_data[((DOUT_DATA_WIDTH*6)-1):(DOUT_DATA_WIDTH*5)];
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@ -303,6 +313,14 @@ module util_rfifo #(
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assign dout_data_1 = dout_data[((DOUT_DATA_WIDTH*2)-1):(DOUT_DATA_WIDTH*1)];
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assign dout_data_0 = dout_data[((DOUT_DATA_WIDTH*1)-1):(DOUT_DATA_WIDTH*0)];
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always @(posedge dout_clk) begin
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if (dout_rst == 1'b1) begin
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dout_valid <= 8'd0;
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end else begin
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dout_valid <= dout_valid_s;
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end
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end
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generate
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for (n = 0; n < NUM_OF_CHANNELS; n = n + 1) begin: g_out
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always @(posedge dout_clk) begin
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