mitx045: ip automatic version update
Adrian Costina
parent
954037a716
commit
20672a3a8b
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@ -66,64 +66,65 @@ create_bd_port -dir I -type intr ps_intr_13
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# instance: sys_ps7
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set sys_ps7 [create_bd_cell -type ip -vlnv xilinx.com:ip:processing_system7:5.5 sys_ps7]
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ad_ip_instance processing_system7 sys_ps7
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source $ad_hdl_dir/projects/common/mitx045/mitx045_system_ps7.tcl
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set_property -dict [list CONFIG.PCW_TTC0_PERIPHERAL_ENABLE {0}] $sys_ps7
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set_property -dict [list CONFIG.PCW_EN_CLK1_PORT {1}] $sys_ps7
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set_property -dict [list CONFIG.PCW_EN_RST1_PORT {1}] $sys_ps7
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set_property -dict [list CONFIG.PCW_EN_CLK2_PORT {1}] $sys_ps7
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set_property -dict [list CONFIG.PCW_EN_RST2_PORT {1}] $sys_ps7
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set_property -dict [list CONFIG.PCW_FPGA0_PERIPHERAL_FREQMHZ {100.0}] $sys_ps7
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set_property -dict [list CONFIG.PCW_FPGA1_PERIPHERAL_FREQMHZ {200.0}] $sys_ps7
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set_property -dict [list CONFIG.PCW_FPGA2_PERIPHERAL_FREQMHZ {200.0}] $sys_ps7
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set_property -dict [list CONFIG.PCW_USE_FABRIC_INTERRUPT {1}] $sys_ps7
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set_property -dict [list CONFIG.PCW_IRQ_F2P_INTR {1}] $sys_ps7
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set_property -dict [list CONFIG.PCW_GPIO_EMIO_GPIO_ENABLE {1}] $sys_ps7
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set_property -dict [list CONFIG.PCW_GPIO_EMIO_GPIO_IO {64}] $sys_ps7
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set_property -dict [list CONFIG.PCW_USE_DMA0 {1}] $sys_ps7
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set_property -dict [list CONFIG.PCW_USE_DMA1 {1}] $sys_ps7
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set_property -dict [list CONFIG.PCW_USE_DMA2 {1}] $sys_ps7
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set_property -dict [list CONFIG.PCW_IRQ_F2P_MODE {REVERSE}] $sys_ps7
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set_property -dict [list CONFIG.PCW_SPI0_PERIPHERAL_ENABLE {1}] $sys_ps7
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set_property -dict [list CONFIG.PCW_SPI0_SPI0_IO {EMIO}] $sys_ps7
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set_property -dict [list CONFIG.PCW_SPI1_PERIPHERAL_ENABLE {1}] $sys_ps7
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||||
set_property -dict [list CONFIG.PCW_SPI1_SPI1_IO {EMIO}] $sys_ps7
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ad_ip_parameter sys_ps7 CONFIG.PCW_TTC0_PERIPHERAL_ENABLE 0
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ad_ip_parameter sys_ps7 CONFIG.PCW_EN_CLK1_PORT 1
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ad_ip_parameter sys_ps7 CONFIG.PCW_EN_RST1_PORT 1
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ad_ip_parameter sys_ps7 CONFIG.PCW_EN_CLK2_PORT 1
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ad_ip_parameter sys_ps7 CONFIG.PCW_EN_RST2_PORT 1
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ad_ip_parameter sys_ps7 CONFIG.PCW_FPGA0_PERIPHERAL_FREQMHZ 100.0
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ad_ip_parameter sys_ps7 CONFIG.PCW_FPGA1_PERIPHERAL_FREQMHZ 200.0
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||||
ad_ip_parameter sys_ps7 CONFIG.PCW_FPGA2_PERIPHERAL_FREQMHZ 200.0
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ad_ip_parameter sys_ps7 CONFIG.PCW_USE_FABRIC_INTERRUPT 1
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ad_ip_parameter sys_ps7 CONFIG.PCW_IRQ_F2P_INTR 1
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ad_ip_parameter sys_ps7 CONFIG.PCW_GPIO_EMIO_GPIO_ENABLE 1
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ad_ip_parameter sys_ps7 CONFIG.PCW_GPIO_EMIO_GPIO_IO 64
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ad_ip_parameter sys_ps7 CONFIG.PCW_USE_DMA0 1
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ad_ip_parameter sys_ps7 CONFIG.PCW_USE_DMA1 1
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ad_ip_parameter sys_ps7 CONFIG.PCW_USE_DMA2 1
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ad_ip_parameter sys_ps7 CONFIG.PCW_IRQ_F2P_MODE REVERSE
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ad_ip_parameter sys_ps7 CONFIG.PCW_SPI0_PERIPHERAL_ENABLE 1
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ad_ip_parameter sys_ps7 CONFIG.PCW_SPI0_SPI0_IO EMIO
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ad_ip_parameter sys_ps7 CONFIG.PCW_SPI1_PERIPHERAL_ENABLE 1
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ad_ip_parameter sys_ps7 CONFIG.PCW_SPI1_SPI1_IO EMIO
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set axi_iic_main [create_bd_cell -type ip -vlnv xilinx.com:ip:axi_iic:2.0 axi_iic_main]
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set_property -dict [list CONFIG.USE_BOARD_FLOW {true}] $axi_iic_main
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set_property -dict [list CONFIG.IIC_BOARD_INTERFACE {Custom}] $axi_iic_main
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ad_ip_instance axi_iic axi_iic_main
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ad_ip_parameter axi_iic_main CONFIG.USE_BOARD_FLOW true
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ad_ip_parameter axi_iic_main CONFIG.IIC_BOARD_INTERFACE Custom
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set sys_concat_intc [create_bd_cell -type ip -vlnv xilinx.com:ip:xlconcat:2.1 sys_concat_intc]
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set_property -dict [list CONFIG.NUM_PORTS {16}] $sys_concat_intc
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ad_ip_instance xlconcat sys_concat_intc
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ad_ip_parameter sys_concat_intc CONFIG.NUM_PORTS 16
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set sys_rstgen [create_bd_cell -type ip -vlnv xilinx.com:ip:proc_sys_reset:5.0 sys_rstgen]
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set_property -dict [list CONFIG.C_EXT_RST_WIDTH {1}] $sys_rstgen
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ad_ip_instance proc_sys_reset sys_rstgen
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ad_ip_parameter sys_rstgen CONFIG.C_EXT_RST_WIDTH 1
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# hdmi peripherals
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set axi_hdmi_clkgen [create_bd_cell -type ip -vlnv analog.com:user:axi_clkgen:1.0 axi_hdmi_clkgen]
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set axi_hdmi_core [create_bd_cell -type ip -vlnv analog.com:user:axi_hdmi_tx:1.0 axi_hdmi_core]
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ad_ip_instance axi_clkgen axi_hdmi_clkgen
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ad_ip_instance axi_hdmi_tx axi_hdmi_core
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set axi_hdmi_dma [create_bd_cell -type ip -vlnv xilinx.com:ip:axi_vdma:6.2 axi_hdmi_dma]
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set_property -dict [list CONFIG.C_M_AXIS_MM2S_TDATA_WIDTH {64}] $axi_hdmi_dma
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set_property -dict [list CONFIG.C_USE_MM2S_FSYNC {1}] $axi_hdmi_dma
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set_property -dict [list CONFIG.C_INCLUDE_S2MM {0}] $axi_hdmi_dma
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ad_ip_instance axi_vdma axi_hdmi_dma
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ad_ip_parameter axi_hdmi_dma CONFIG.C_M_AXIS_MM2S_TDATA_WIDTH 64
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ad_ip_parameter axi_hdmi_dma CONFIG.C_USE_MM2S_FSYNC 1
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ad_ip_parameter axi_hdmi_dma CONFIG.C_INCLUDE_S2MM 0
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# audio peripherals
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set sys_audio_clkgen [create_bd_cell -type ip -vlnv xilinx.com:ip:clk_wiz:5.3 sys_audio_clkgen]
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set_property -dict [list CONFIG.PRIM_IN_FREQ {200.000}] $sys_audio_clkgen
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set_property -dict [list CONFIG.CLKOUT1_REQUESTED_OUT_FREQ {12.288}] $sys_audio_clkgen
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set_property -dict [list CONFIG.USE_LOCKED {false}] $sys_audio_clkgen
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set_property -dict [list CONFIG.USE_RESET {true} CONFIG.RESET_TYPE {ACTIVE_LOW}] $sys_audio_clkgen
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ad_ip_instance clk_wiz sys_audio_clkgen
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ad_ip_parameter sys_audio_clkgen CONFIG.PRIM_IN_FREQ 200.000
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ad_ip_parameter sys_audio_clkgen CONFIG.CLKOUT1_REQUESTED_OUT_FREQ 12.288
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ad_ip_parameter sys_audio_clkgen CONFIG.USE_LOCKED false
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ad_ip_parameter sys_audio_clkgen CONFIG.USE_RESET true
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ad_ip_parameter sys_audio_clkgen CONFIG.RESET_TYPE ACTIVE_LOW
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set axi_spdif_tx_core [create_bd_cell -type ip -vlnv analog.com:user:axi_spdif_tx:1.0 axi_spdif_tx_core]
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set_property -dict [list CONFIG.DMA_TYPE {1}] $axi_spdif_tx_core
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set_property -dict [list CONFIG.S_AXI_ADDRESS_WIDTH {16}] $axi_spdif_tx_core
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ad_ip_instance axi_spdif_tx axi_spdif_tx_core
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ad_ip_parameter axi_spdif_tx_core CONFIG.DMA_TYPE 1
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ad_ip_parameter axi_spdif_tx_core CONFIG.S_AXI_ADDRESS_WIDTH 16
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set axi_i2s_adi [create_bd_cell -type ip -vlnv analog.com:user:axi_i2s_adi:1.0 axi_i2s_adi]
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set_property -dict [list CONFIG.DMA_TYPE {1}] $axi_i2s_adi
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set_property -dict [list CONFIG.S_AXI_ADDRESS_WIDTH {16}] $axi_i2s_adi
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ad_ip_instance axi_i2s_adi axi_i2s_adi
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ad_ip_parameter axi_i2s_adi CONFIG.DMA_TYPE 1
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ad_ip_parameter axi_i2s_adi CONFIG.S_AXI_ADDRESS_WIDTH 16
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# system reset/clock definitions
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@ -1,110 +1,110 @@
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set_property CONFIG.PCW_PRESET_BANK0_VOLTAGE {LVCMOS 1.8V} [get_bd_cells sys_ps7]
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set_property CONFIG.PCW_PRESET_BANK1_VOLTAGE {LVCMOS 1.8V} [get_bd_cells sys_ps7]
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ad_ip_parameter sys_ps7 CONFIG.PCW_PRESET_BANK0_VOLTAGE {LVCMOS 1.8V}
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ad_ip_parameter sys_ps7 CONFIG.PCW_PRESET_BANK1_VOLTAGE {LVCMOS 1.8V}
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set_property CONFIG.PCW_GPIO_MIO_GPIO_ENABLE {1} [get_bd_cells sys_ps7]
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set_property CONFIG.PCW_ENET0_PERIPHERAL_ENABLE {1} [get_bd_cells sys_ps7]
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set_property CONFIG.PCW_ENET0_ENET0_IO {MIO 16 .. 27} [get_bd_cells sys_ps7]
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set_property CONFIG.PCW_ENET0_GRP_MDIO_ENABLE {1} [get_bd_cells sys_ps7]
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||||
set_property CONFIG.PCW_ENET0_GRP_MDIO_IO {MIO 52 .. 53} [get_bd_cells sys_ps7]
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set_property CONFIG.PCW_ENET0_RESET_ENABLE {1} [get_bd_cells sys_ps7]
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set_property CONFIG.PCW_ENET0_RESET_IO {MIO 47} [get_bd_cells sys_ps7]
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ad_ip_parameter sys_ps7 CONFIG.PCW_GPIO_MIO_GPIO_ENABLE {1}
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ad_ip_parameter sys_ps7 CONFIG.PCW_ENET0_PERIPHERAL_ENABLE {1}
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ad_ip_parameter sys_ps7 CONFIG.PCW_ENET0_ENET0_IO {MIO 16 .. 27}
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ad_ip_parameter sys_ps7 CONFIG.PCW_ENET0_GRP_MDIO_ENABLE {1}
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ad_ip_parameter sys_ps7 CONFIG.PCW_ENET0_GRP_MDIO_IO {MIO 52 .. 53}
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||||
ad_ip_parameter sys_ps7 CONFIG.PCW_ENET0_RESET_ENABLE {1}
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ad_ip_parameter sys_ps7 CONFIG.PCW_ENET0_RESET_IO {MIO 47}
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set_property CONFIG.PCW_USB0_PERIPHERAL_ENABLE {1} [get_bd_cells sys_ps7]
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||||
set_property CONFIG.PCW_USB0_RESET_ENABLE {1} [get_bd_cells sys_ps7]
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set_property CONFIG.PCW_USB0_RESET_IO {MIO 7} [get_bd_cells sys_ps7]
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||||
set_property CONFIG.PCW_I2C0_PERIPHERAL_ENABLE {1} [get_bd_cells sys_ps7]
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||||
set_property CONFIG.PCW_I2C0_I2C0_IO {MIO 50 .. 51} [get_bd_cells sys_ps7]
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set_property CONFIG.PCW_I2C0_RESET_ENABLE {1} [get_bd_cells sys_ps7]
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set_property CONFIG.PCW_I2C0_RESET_IO {MIO 46} [get_bd_cells sys_ps7]
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||||
ad_ip_parameter sys_ps7 CONFIG.PCW_USB0_PERIPHERAL_ENABLE {1}
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ad_ip_parameter sys_ps7 CONFIG.PCW_USB0_RESET_ENABLE {1}
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ad_ip_parameter sys_ps7 CONFIG.PCW_USB0_RESET_IO {MIO 7}
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||||
ad_ip_parameter sys_ps7 CONFIG.PCW_I2C0_PERIPHERAL_ENABLE {1}
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ad_ip_parameter sys_ps7 CONFIG.PCW_I2C0_I2C0_IO {MIO 50 .. 51}
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ad_ip_parameter sys_ps7 CONFIG.PCW_I2C0_RESET_ENABLE {1}
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||||
ad_ip_parameter sys_ps7 CONFIG.PCW_I2C0_RESET_IO {MIO 46}
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||||
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||||
set_property CONFIG.PCW_SD0_PERIPHERAL_ENABLE {1} [get_bd_cells sys_ps7]
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||||
set_property CONFIG.PCW_SD0_GRP_CD_ENABLE {1} [get_bd_cells sys_ps7]
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||||
set_property CONFIG.PCW_SD0_GRP_CD_IO {MIO 14} [get_bd_cells sys_ps7]
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||||
set_property CONFIG.PCW_SD0_GRP_WP_ENABLE {1} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_SDIO_PERIPHERAL_FREQMHZ {50} [get_bd_cells sys_ps7]
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_SD0_PERIPHERAL_ENABLE {1}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_SD0_GRP_CD_ENABLE {1}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_SD0_GRP_CD_IO {MIO 14}
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||||
ad_ip_parameter sys_ps7 CONFIG.PCW_SD0_GRP_WP_ENABLE {1}
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||||
ad_ip_parameter sys_ps7 CONFIG.PCW_SDIO_PERIPHERAL_FREQMHZ {50}
|
||||
|
||||
set_property CONFIG.PCW_UART1_PERIPHERAL_ENABLE {1} [get_bd_cells sys_ps7]
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||||
set_property CONFIG.PCW_UART_PERIPHERAL_FREQMHZ {50} [get_bd_cells sys_ps7]
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UART1_PERIPHERAL_ENABLE {1}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UART_PERIPHERAL_FREQMHZ {50}
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||||
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||||
set_property CONFIG.PCW_QSPI_PERIPHERAL_ENABLE {1} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_QSPI_GRP_SINGLE_SS_ENABLE {0} [get_bd_cells sys_ps7]
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||||
set_property CONFIG.PCW_QSPI_GRP_IO1_ENABLE {1} [get_bd_cells sys_ps7]
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||||
set_property CONFIG.PCW_QSPI_GRP_FBCLK_ENABLE {1} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_TTC0_PERIPHERAL_ENABLE {1} [get_bd_cells sys_ps7]
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_QSPI_PERIPHERAL_ENABLE {1}
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||||
ad_ip_parameter sys_ps7 CONFIG.PCW_QSPI_GRP_SINGLE_SS_ENABLE {0}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_QSPI_GRP_IO1_ENABLE {1}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_QSPI_GRP_FBCLK_ENABLE {1}
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||||
ad_ip_parameter sys_ps7 CONFIG.PCW_TTC0_PERIPHERAL_ENABLE {1}
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||||
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||||
set_property CONFIG.PCW_UIPARAM_DDR_PARTNO {Custom} [get_bd_cells sys_ps7]
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||||
set_property CONFIG.PCW_UIPARAM_DDR_BUS_WIDTH {32 Bit} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_USE_INTERNAL_VREF {1} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_DRAM_WIDTH {16 Bits} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_DEVICE_CAPACITY {4096 MBits} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_SPEED_BIN {DDR3_1066F} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_COL_ADDR_COUNT {10} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_CL {7} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_CWL {5} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_T_RCD {7} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_T_RP {7} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_T_RC {49.5} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_T_RAS_MIN {36.0} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_T_FAW {45.0} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_TRAIN_WRITE_LEVEL {1} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_TRAIN_READ_GATE {1} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_TRAIN_DATA_EYE {1} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_DQS_TO_CLK_DELAY_0 {0.078} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_DQS_TO_CLK_DELAY_1 {0.074} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_DQS_TO_CLK_DELAY_2 {-0.059} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_DQS_TO_CLK_DELAY_3 {-0.055} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_BOARD_DELAY0 {0.482} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_BOARD_DELAY1 {0.484} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_BOARD_DELAY2 {0.417} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_UIPARAM_DDR_BOARD_DELAY3 {0.416} [get_bd_cells sys_ps7]
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_PARTNO {Custom}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_BUS_WIDTH {32 Bit}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_USE_INTERNAL_VREF {1}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_DRAM_WIDTH {16 Bits}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_DEVICE_CAPACITY {4096 MBits}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_SPEED_BIN {DDR3_1066F}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_COL_ADDR_COUNT {10}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_CL {7}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_CWL {5}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_T_RCD {7}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_T_RP {7}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_T_RC {49.5}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_T_RAS_MIN {36.0}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_T_FAW {45.0}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_TRAIN_WRITE_LEVEL {1}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_TRAIN_READ_GATE {1}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_TRAIN_DATA_EYE {1}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_DQS_TO_CLK_DELAY_0 {0.078}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_DQS_TO_CLK_DELAY_1 {0.074}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_DQS_TO_CLK_DELAY_2 {-0.059}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_DQS_TO_CLK_DELAY_3 {-0.055}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_BOARD_DELAY0 {0.482}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_BOARD_DELAY1 {0.484}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_BOARD_DELAY2 {0.417}
|
||||
ad_ip_parameter sys_ps7 CONFIG.PCW_UIPARAM_DDR_BOARD_DELAY3 {0.416}
|
||||
|
||||
set_property CONFIG.PCW_MIO_16_IOTYPE {HSTL 1.8V} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_MIO_16_PULLUP {disabled} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_MIO_17_IOTYPE {HSTL 1.8V} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_MIO_17_PULLUP {disabled} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_MIO_18_IOTYPE {HSTL 1.8V} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_MIO_18_PULLUP {disabled} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_MIO_19_IOTYPE {HSTL 1.8V} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_MIO_19_PULLUP {disabled} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_MIO_20_IOTYPE {HSTL 1.8V} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_MIO_20_PULLUP {disabled} [get_bd_cells sys_ps7]
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||||
set_property CONFIG.PCW_MIO_21_IOTYPE {HSTL 1.8V} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_MIO_21_PULLUP {disabled} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_MIO_22_IOTYPE {HSTL 1.8V} [get_bd_cells sys_ps7]
|
||||
set_property CONFIG.PCW_MIO_22_PULLUP {disabled} [get_bd_cells sys_ps7]
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|
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|
||||
set_property CONFIG.PCW_MIO_24_IOTYPE {HSTL 1.8V} [get_bd_cells sys_ps7]
|
||||
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|
||||
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|
||||
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|
||||
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|
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|
||||
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|
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|
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|
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